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xc7z010_DDR等长=采用JLC的3313叠层。用5.2线宽，3W原则，拉了6

TA的每日心情

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发表于 2023-5-4 16:55:09 | 显示全部楼层 |阅读模式

为了更贴近实战，采用JLC的3313叠层。用5.2线宽，3W原则，拉了6遍的线，终于完成。
再宽0.1mil的线就拉不了啦，只能做到53点几欧，也只能这样将就一下了。
不知道设置DDR的规则有没有什么问题，麻烦老师看一下，谢谢！
地址线的时钟有两组规则，删不掉。
QQ截图20230504165957.jpg

QQ截图20230504165957.jpg

下载 (1).png

QQ截图20230504165720.jpg

QQ截图20230504225851.jpg

project2_xc7z010_ntpcb3356619.brd (2.02 MB, 下载次数: 1) xc7z010的PCB

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TA的每日心情

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发表于 2023-5-5 10:12:42 | 显示全部楼层

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发表于 2023-6-13 22:52:24 | 显示全部楼层

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发表于 2023-8-11 09:35:27 | 显示全部楼层

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