DHH教你深入浅出DCDC设计（一）
DC-DC设计：均衡环路响应与纹波（第一篇）理解环路响应与输出纹波的本质在DC-DC降压变换器设计中，环路响应和输出纹波是一对需要同时优化的关键指标。很多设计者在调试时容易陷入两个极端：要么过度追求极快的瞬态响应，导致环路不稳定；要么过度追求极低的输出纹波，牺牲了动态性能。要找到平衡点，首先需要理解两者的本质及其相互制约的关系。一、环路响应是什么环路响应描述的是DC-DC变换器对负载变化或输入电压变化的动态调节能力。当GPU负载突然从轻载跳到满载时，输出电压会先下跌，然后控制器通过反馈环路调整占空比，把电压拉回设定值。这个过程中，电压跌落幅度、恢复时间、以及是否出现振铃，都取决于环路响应特性。环路响应的核心指标包括：穿越频率，即开环增益下降到0dB的频率，决定了系统响应速度；相位裕度，即增益穿越0dB时相位与-180度的差值，决定了系统稳定性；增益裕度，即相位达到-180度时增益低于0dB的程度，决定了抗振荡能力。穿越频率越高，系统响应越快，但相位裕度越难保证。相位裕度低于45度时，系统会出现明显振铃；低于30度时，可能持续振荡。通常设计目标为相位裕度大于45度，增益裕度大于10dB。二、输出纹波是什么输出纹波是DC-DC变换器在稳态工作时，输出电压上叠加的周期性波动。它主要由两部分组成：电感纹波电流在输出电容ESR上产生的电压，以及电感纹波电流对输出电容充放电产生的电压。电感纹波电流的计算公式为：
ΔIL = (Vout / (fsw × L)) × (1 - Vout / Vin)其中fsw为开关频率，L为电感值，Vin为输入电压，Vout为输出电压。输出纹波的近似计算公式为：
ΔVout ≈ ΔIL × ESR + ΔIL / (8 × fsw × Cout)第一项由电容ESR主导，第二项由电容容量主导。在低ESR MLCC为主流的今天，第二项往往占主导。但ESR仍然影响环路稳定性，因为ESR在反馈环路中引入了一个零点。三、两者的相互制约关系环路响应和输出纹波之间的制约关系，主要体现在以下几个参数上：开关频率。提高开关频率可以减小电感纹波电流，从而降低输出纹波，同时允许使用更小的电感和电容。但高开关频率会增加开关损耗，降低效率，并且环路带宽受限于开关频率，通常穿越频率不能超过开关频率的五分之一到十分之一。电感值。增大电感可以减小纹波电流，降低输出纹波。但大电感意味着更大的体积和DCR，同时会降低功率级的截止频率，使环路响应变慢。在负载阶跃时，电感电流上升速率变慢，输出电压跌落更深。输出电容值。增大输出电容可以降低纹波，并且提供更多的电荷缓冲，减小负载阶跃时的电压跌落。但大电容会降低环路带宽，因为功率级的输出极点频率随电容增大而降低。输出电容ESR。ESR在环路中引入一个零点，可以提升相位裕度，改善稳定性。但ESR增大会直接增加纹波中的ESR分量。低ESR MLCC降低了纹波，但也移除了这个零点，可能导致相位裕度不足。四、为什么需要均衡如果不均衡，会出现以下典型问题：场景一：只追求低纹波。选择大电感、大电容、低ESR，结果是纹波很小，但环路带宽很低，负载阶跃时电压跌落大、恢复慢。GPU可能因瞬间欠压而降频或报错。场景二：只追求快响应。选择小电感、小电容、高带宽，结果是瞬态响应快，但纹波大，且相位裕度不足，可能出现振铃或振荡。场景三：忽略ESR的零点作用。使用极低ESR的MLCC后，环路相位裕度下降，虽然稳态纹波很低，但动态响应出现严重振铃。因此，均衡设计的核心思路是：在满足纹波要求的前提下，尽可能提高环路带宽和相位裕度，使瞬态响应满足GPU负载的快速变化需求。五、均衡设计的总体框架均衡设计可以分为以下步骤：第一步，明确负载需求。GPU的负载阶跃幅度、上升时间、允许的电压跌落和过冲是多少。SXM2 GPU的负载变化非常剧烈，从几十安培到上百安培的阶跃可能在微秒级完成。第二步，确定开关频率。根据效率、体积和环路带宽需求，选择合适的开关频率。对于GPU辅助供电，300kHz到600kHz是常见范围。第三步，选择电感值。根据允许的纹波电流比例，通常取满载电流的20%到40%，计算电感值。同时考虑电感的饱和电流和DCR。第四步，选择输出电容。根据允许的纹波电压和负载阶跃时的电荷需求，计算所需电容值。同时考虑电容的ESR和ESL。第五步，设计补偿网络。根据功率级的极点和零点，设计补偿网络的极点和零点，使环路带宽满足要求，相位裕度大于45度。第六步，验证和迭代。通过仿真和实测，验证稳态纹波和瞬态响应，必要时调整参数。六、本篇小结环路响应和输出纹波是DC-DC设计中不可分割的两个方面。它们通过开关频率、电感值、电容值和ESR相互耦合。均衡设计的本质是在约束条件下，找到使系统既稳定又满足动态要求的参数组合。理解这些参数之间的制约关系，是后续深入设计的基础。下一篇将具体分析环路响应的关键参数及其对系统稳定性的影响，并给出设计方法。
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