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[资料贡献] 在高速设计中，如何解决信号的完整性问题？

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leslie_aqiang

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发表于 2021-2-1 08:59 | 显示全部楼层 |阅读模式

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信号完整性基本上是阻抗匹配的问题。而影响阻抗匹配的因素有信号源的架构和输出阻抗(output impedance)，走线的特性阻抗，负载端的特性，走线的拓朴(topology)架构等。解决的方式是靠端接(termination)与调整走线的拓朴。

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hgf000

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发表于 2021-2-1 09:58 | 显示全部楼层

加油欧利给

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feng123456

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高天原

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shakencity

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cloudie2000

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lik818

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nj20044

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发表于 2021-2-4 00:37 | 显示全部楼层

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